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Nanfei Microelectronics fa jobs (salary & requirements)

Nanfei Microelectronics fa salary range: 20K - 50K, where 100% of positions earn ¥20-50K
Nanfei Microelectronics fa salary range: 20K-50K, the most positions earn 30-50K, based on 11 related positions in the past year, as of 2026-10-18
¥20-50K
100% of positions earn

Note: the average salary is analyzed based on job postings published by the company. We recommend reviewing it together with position type, education, region and experience.

Nanfei Microelectronics fa salary changes over the years

Note: the data depends on salary samples of online job postings in the corresponding years and does not fully represent the actual situation within the company. For reference only.

Education requirements: 本科 is the most common

What education does Nanfei Microelectronics require for fa positions? 本科占比最多,占100%

Salary by education

Nanfei Microelectronics fa salaries by education: 本科 ¥38.6K.

Experience requirements: 3-5年 is the most common

What experience does Nanfei Microelectronics require for fa positions? 3-5年占比最多,占63.6%,5-10年占36.4%

Salary by experience

Nanfei Microelectronics fa salaries by experience: 3-5年 ¥37.9K, 5-10年 ¥40.0K.

Nanfei Microelectronics fa hiring regions: mainly 上海, 成都

In which cities does Nanfei Microelectronics have offices for fa positions? The main distribution is as follows: 上海 accounts for 27.3%. Click this module to view the proportions of other cities, based on job postings in the past year. For reference only.

Nanfei Microelectronics fa hiring trends over the years

Nanfei Microelectronics fa changes in hiring volume over the years

What does Nanfei Microelectronics fa do

Based on related job postings of Nanfei Microelectronics in the past year
  • PE工程师(芯片FAB)

    成都-青羊区 | 5-10年 | 本科以上 | 2026-03-17
    25000-50000
    岗位职责:
    1、负责TO前fab工艺的良率分析,对成本和良率稳定性进行可行性分析;
    2、负责协同DFT和ATE 测试工程师,完善、提升DFT可测试性方案,权衡测试覆盖率和良率,保障*终良率符合项目基线的预期;
    3、负责split table 方案制定和实施
    4、负责开发阶段WAT测试数据分析,确定Corner工艺拉偏是否符合Split table方案预期,并结合NTO后的CP/FT测试良率,主导分析定位fail原因,联合fab 定制process window 调整方案;
    5、负责开发阶段各IP模块的良率统计分析,建立IP测试良率库,供IP选型;
    6、负责小批量和量产阶段测试良率统计分析,以及低良分析改善(只负责fab和ATE 侧低良);
    7、负责跟FAB 厂技术和质量的对接和管理;
    8、负责失效芯片的fab端问题定位分析;
    9、协同可靠性测试工程师完成可靠性设计和测试数据分析,尤其对HTOL和LTOL的失效,定位到是fab工艺质量问题的,需要主导拉通FAB 改善;

    任职要求:
    1、至少熟悉一家主流fab厂的芯片制造工艺流程,对wafer 材料和结构有一定了解
    2、有跟主流fab 厂对接经验,熟悉fab提良流程
    3、了解DFT测试原理,对基本的DFT方法有一定认识;
    4、了解ATE测试流程和原理,熟悉ATE测试数据转换和分析软件
    5、掌握测试数据分析软件
    6、了解网络类芯片功能和应用
    7、熟悉可靠性标准和设计方法,掌握FA分析流程和方法,有一定FA定位分析能力
    8、了解QFN/FCBGA 封装工艺流程和质量标准
    9、了解测试厂的流程和质量标准
    More
  • PE工程师(FAB)

    上海 | 5-10年 | 本科以上 | 2026-04-01
    25000-50000 򀀩
  • FA / 芯片失效分析

    成都 | 5-10年 | 本科以上 | 2026-05-19
    20-40k 򀀩
  • 软件FAE工程师(PCIE方向)

    北京 | 3-5年 | 本科以上 | 2026-08-31
    30-45k 򀀩
  • 软件FAE工程师(PCIE/交换)

    常州 | 3-5年 | 本科以上 | 2026-07-09
    30-45k 򀀩
  • FAE工程师(硬件背景)

    上海 | 3-5年 | 本科以上 | 2026-07-09
    ? 򀀩
  • Python后端(fastapi+AI Agent)

    深圳 | 5-10年 | 本科以上 | 2026-07-09
    ? 򀀩
  • 软件FAE工程师(智算方向)

    上海-徐汇区 | 3-5年 | 本科以上 | 2026-09-21
    ? 򀀩

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